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Este documento trata sobre una implementación de FPGA de un modulador y demodulador de FM de alto rendimiento para un sistema de radio definido por software (SDR). Los componentes individuales del modulador y demodulador de FM propuestos han sido optimizados de tal manera que el diseño general consta de características de alta velocidad, optimización de área y bajo consumo de energía. El modulador y demodulador contienen un sintetizador de frecuencia digital directa (DDFS) optimizado basado en la técnica de simetría de cuarto de onda para generar la frecuencia portadora con un rango dinámico libre de espurias (SFDR) de más de 64 dB. El modulador de FM utiliza una versión en cascada del DDFS para admitir la conversión ascendente en el dominio digital. El modulador y demodulador de FM propuestos han sido implementados y probados utilizando la FPGA XC2VP30-7ff896 como dispositivo objetivo y pueden operar a una frecuencia máxima de 334,5 MHz y 131 MHz, involucrando alrededor de 1,93K
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