Las plataformas de computación en chip están evolucionando de sistemas mononúcleo basados en bus a sistemas multinúcleo basados en red, que en este artículo se denominan arquitecturas de computación paralela a gran escala en chip (OLPC). Las OLPC homogéneas presentan una gran regularidad y escalabilidad gracias a sus núcleos y routers idénticos. Las aplicaciones de datos paralelos tienen sus subconjuntos de datos paralelos que son manejados individualmente por el mismo programa que se ejecuta en diferentes núcleos. Por lo tanto, las aplicaciones de datos paralelos son capaces de obtener un buen aumento de velocidad en OLPCs homogéneas. El artículo aborda el modelado del rendimiento de aceleración de los OLPC homogéneos para aplicaciones de datos paralelos. Al establecer el modelo de rendimiento del aumento de velocidad, se modelan y analizan en detalle la latencia de la comunicación de red y las formas de almacenamiento de datos de las aplicaciones de datos paralelos. Se proponen dos conceptos abstractos (paquete serie equivalente y comunicación serie equivalente) para construir el modelo de latencia de comunicación de red. Se adoptan los modelos de tráfico uniforme y hotspot para reflejar las formas de almacenamiento de datos. Se presentan algunas sugerencias útiles durante el análisis del modelo de rendimiento. Por último, se ejecutan tres aplicaciones de datos en paralelo en nuestra plataforma experimental OLPC homogénea de ciclo preciso para validar los resultados analíticos y demostrar que nuestro estudio proporciona una forma viable de estimar y evaluar el rendimiento de las aplicaciones de datos en paralelo en OLPC homogéneas.
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