El código polar ha demostrado alcanzar la capacidad simétrica de los canales sin memoria. Sin embargo, el algoritmo de decodificación por cancelación sucesiva es inherentemente serial, lo que resultará en una alta latencia y baja capacidad de procesamiento. Para lograr una alta capacidad de procesamiento, diseñamos un decodificador polar profundamente segmentado y optimizamos los elementos de procesamiento y la estructura de almacenamiento. También proponemos un esquema de cuantificación no uniforme de punto fijo mejorado, que se acerca al rendimiento de punto flotante. Se presenta una estrategia de control de dos niveles para simplificar el controlador. Además, adoptamos una estructura FIFO para implementar la memoria y proponemos el decodificador de pipeline de 348 etapas.
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