El Sensor de Píxeles Activos Monolíticos CMOS (MAPS) para el detector de vértices (VXD) del Colisionador Lineal Internacional (ILC) expresa requisitos estrictos en su electrónica de lectura analógica, específicamente en el convertidor analógico a digital (ADC). Este documento se centra en el diseño y la optimización de una nueva arquitectura de un ADC Flash de 4 bits en paralelo de columnas, de baja potencia, alta velocidad y pequeña área. Más adelante en este estudio, proponemos interponer un bloque S/H en el convertidor. Esta integración del bloque S/H aumenta la sensibilidad del convertidor ante la amplitud muy pequeña de la señal de entrada del sensor y proporciona un tiempo suficiente al convertidor para codificar la señal de entrada. Este ADC se desarrolla en un proceso CMOS de 0.18m con un paso de píxel de 35m. El ADC propuesto responde a las restricciones de disipación de potencia, tamaño y velocidad para los MAPS compuestos por una matriz de 64 fil
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