Este documento presenta una metodología para integrar un coprocesador difuso descrito en VHDL (Lenguaje de Descripción de Hardware VHSIC) en un procesador suave incrustado en un FPGA, lo que aumenta el rendimiento de todo el sistema, ya que el controlador utiliza el paralelismo a nivel de circuito para aplicaciones de alta velocidad de demanda, el resto de la aplicación puede ser escrita en C/C++. Utilizamos el procesador suave ARM de 32 bits, que permite la programación secuencial y paralela. El coprocesador FLC incorpora un método de ajuste que permite manipular la respuesta del sistema. Mostramos resultados experimentales utilizando un controlador difuso PD+I como coprocesador incrustado.
Esta es una versión de prueba de citación de documentos de la Biblioteca Virtual Pro. Puede contener errores. Lo invitamos a consultar los manuales de citación de las respectivas fuentes.
Artículos:
Aplicación de una Nueva Derivada Fraccional Generalizada y Rango de Medidas de Control sobre la Dinámica de Transmisión del Cólera
Artículos:
Soluciones periódicas de algunos sistemas de ecuaciones diferenciales polinómicas en dimensión 3 a través de la teoría del promediado.
Artículos:
Método de Multiplicadores de Lagrange Aumentados para la Recuperación de Tensores y sus Aplicaciones
Artículos:
Teoremas de Punto Fijo de Mapeo Univaluado para -Distancia en Espacios Métricos de Cono
Artículos:
Condiciones necesarias para una clase de problemas de control óptimo en escalas de tiempo
Artículos:
Comportamiento del aguacate Hass liofilizado durante la operación de rehidratación
Artículos:
Caracterización estructural de la materia orgánica de tres suelos provenientes del municipio de Aquitania-Boyacá, Colombia
Informes y Reportes:
Técnicas de recuperación de suelos contaminados
Artículos:
Una revisión de la etiopatogenia y características clínicas e histopatológicas del melanoma mucoso oral.