El escalado adicional de la tecnología CMOS se vuelve desafiante al enfrentar la limitación de la reducción del tamaño de las características. Autómatas celulares de puntos cuánticos (QCA), una alternativa potencial al CMOS, prometen un diseño digital eficiente a escala nanométrica. Las investigaciones sobre la reducción de primitivas de QCA (puertas de mayoría e inversores) para varios sumadores son limitadas, y existen muy pocos diseños de referencia. Como resultado, el diseño de sumadores en el marco de QCA está ganando importancia en la investigación reciente. Este trabajo tiene como objetivo desarrollar una arquitectura de sumador completo multicapa en el marco de QCA basada en la puerta de mayoría de cinco entradas propuesta aquí. Se logra una zona de reloj mínimo (2 relojes) con alta compactación (0.01m) para un sumador completo alrededor de QCA. Además, la utilidad de dicho diseño se establece con la síntesis de lógica de alto nivel. Los resultados experimentales ilustran las mejoras significativas
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