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Con la evolución de la tecnología, la complejidad del sistema aumentó y los campos de aplicación del sistema embebido se expandieron. Las aplicaciones actuales necesitan un alto grado de rendimiento, flexibilidad y entornos de desarrollo eficientes. Hoy en día, la lógica reconfigurable permite cumplir con los requisitos de procesamiento en el chip con nuevos beneficios resultantes de la reconfiguración parcial y dinámica. Pero la dimensión introducida en el diseño de estos sistemas requiere más abstracción para gestionar su complejidad y modelos eficientes para proporcionar estimaciones preliminares fiables. Mientras que los sistemas multiprocesador clásicos pueden ser modelados sin dificultad, el uso de la reconfiguración parcial en tiempo de ejecución en sistemas en chips flexibles heterogéneos generalmente no está cubierto. La contribución de este artículo es abordar esto con una extensión del lenguaje AADL capaz de modelar la lógica reconfigurable, posiblemente considerando la reconfiguración dinámica y los requisitos de consumo de
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