La técnica de reconfiguración dinámica (DRFI) es una técnica que emplea entradas en tiempo de ejecución para llevar a cabo pruebas funcionales en línea de los recursos lógicos y de interconexión de FPGA implementados en campo sin vectores de prueba. En el momento del diseño, se crean un conjunto diverso de configuraciones de bitstream funcionalmente idénticas que utilizan recursos de hardware alternativos en la estructura de la FPGA. Se impone un orden en el conjunto de configuraciones actualizado por la precedencia de indexación de PageRank. Las configuraciones que utilizan recursos permanentemente dañados y, por lo tanto, manifiestan salidas discrepantes, reciben un rango más bajo y por lo tanto son menos preferidas para la instanciación en la FPGA. Los resultados indican una identificación precisa de configuraciones sin fallos en un conjunto de bitstreams pregenerados con un bajo número de reconfiguraciones y evaluaciones de entrada. Para los circuitos de referencia de MCNC, la reducción observada en las evaluaciones de entrada es de hasta un 75% al comparar la técnica DRFI
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