Este trabajo presenta un método de particionamiento basado en el ordenamiento topológico y la nivelación. El método propuesto, denominado RPL, realiza el particionamiento multi-FPGA teniendo en cuenta seis restricciones de particionamiento diferentes. También comparamos RPL con dos algoritmos existentes. El primero es un método de particionamiento jerárquico basado en el ordenamiento topológico (HP). El segundo es un algoritmo recursivo basado en la heurística de bipartición de Fiduccia y Mattheyses (RP). Los resultados experimentales en siete aplicaciones de referencia mapeadas en tres arquitecturas de hardware diferentes demostraron que el enfoque RPL propuesto lograba menos particiones en menos tiempo en comparación con los algoritmos RP y HP.
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