La verificación funcional se ha convertido en uno de los principales cuellos de botella en el diseño rentable de sistemas empotrados, sobre todo para multiprocesadores simétricos. Se calcula que la verificación en su totalidad supone hasta el 60% de los recursos de diseño, incluidos la duración, los recursos informáticos y el personal total. La verificación basada en simulación es un enfoque utilizado desde hace tiempo para localizar errores de diseño en la verificación de multiprocesadores simétricos. El mayor reto de la verificación basada en simulación es la creación del modelo de referencia del multiprocesador simétrico. En este artículo, proponemos un modelo de referencia de multiprocesador simétrico eficiente, Hybrid Model, escrito con SystemC. SystemC puede proporcionar un entorno de simulación de alto nivel y es más rápido que los lenguajes tradicionales de descripción de hardware. El Modelo Híbrido se ha implementado en una verificación eficiente de un multiprocesador simétrico de 32 bits. Los resultados experimentales muestran que nuestro modelo propuesto es un modelo de referencia de multiprocesador simétrico rápido, preciso y eficiente, y es capaz de ayudar a los diseñadores a localizar errores de diseño con facilidad y precisión.
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